Verilog中常见Warnning或error

Verilog中常见Warnning或errorWarning 13024 Outputpinsar 这种 Warnning 要检查你 output 引脚定义是否有问题 比如你定义的是 4bit 的数据 你赋值的时候赋的三位的值 他就会报这样的错误

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1.

Warning (13024): Output pins are stuck at VCC or GND
这种Warnning要检查你output引脚定义是否有问题,比如你定义的是4bit的数据,你赋值的时候赋的三位的值,他就会报这样的错误。
 

2.

Verilog中常见Warnning或error

仿真时如果出现这种错误,查看一下顶层文件是不是正确

3.

Verilog中常见Warnning或error

检查下是否已经打开一个仿真窗口了

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